MANUAL DE VHDL: SÍNTESIS LÓGICA PARA PLDS

MANUAL DE VHDL: SÍNTESIS LÓGICA PARA PLDS

Editorial:
UNIVERSIDAD DE DEUSTO
Ano de edición:
Materia
Electrónica
ISBN:
978-84-9830-011-6
Páxinas:
236
Encadernación:
Rústica (Tapa blanda)
Colección:
INGENIERIA
15,00 €
IVE incluído
Descatalogado

El lector tiene un libro que le enseñará de una forma práctica a utilizar el VHDL y a implementar estos diseños en CPLDs y FPGAs de la empresa Xilinx. El desarrollo del libro tie ne como hilo conductor a los ejercicios, cuyos planteamientos dan pie a un uso cada vez más potente del VHDL.

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